<?xml version="1.0" encoding="utf-8" standalone="yes"?><rss version="2.0" xmlns:atom="http://www.w3.org/2005/Atom"><channel><title>Asic on QSysArch - Quantum Computer System Architecture</title><link>https://qsysarch.com/ja/categories/asic/</link><description>Recent content in Asic on QSysArch - Quantum Computer System Architecture</description><generator>Hugo</generator><language>ja</language><lastBuildDate>Fri, 10 Jul 2026 00:00:00 +0000</lastBuildDate><atom:link href="https://qsysarch.com/ja/categories/asic/index.xml" rel="self" type="application/rss+xml"/><item><title>半導体計測：原子スケール測定</title><link>https://qsysarch.com/ja/posts/semiconductor-metrology/</link><pubDate>Fri, 10 Jul 2026 00:00:00 +0000</pubDate><guid>https://qsysarch.com/ja/posts/semiconductor-metrology/</guid><description>&lt;p&gt;&#10;&lt;img class="glightbox" src="https://qsysarch.com/images/asic-metrology/how-to-make-a-sillicon-chip.webp#right-300px" alt="" /&gt;この短いメモは、シリコンウェーハの検査に使用される半導体計測で使用される方法論をまとめたものです。&lt;/p&gt;&#10;&lt;p&gt;半導体計測とは、ASICの製造に使用されるウェハーの精密な測定と分析を指します。その目的は、デバイス製造における原子スケールでのトランジスタ配置の品質と性能を確保することであり、製造工程におけるピコメートル単位の誤差でさえ歩留まりに影響を与えるためです。&lt;/p&gt;&#10;&lt;h1 id="計測技術"&gt;&#10; 計測技術&#10; &lt;a class="heading-link" href="#%e8%a8%88%e6%b8%ac%e6%8a%80%e8%a1%93"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h1&gt;&#10;&lt;p&gt;以下に、品質測定に使用される技術と機器の一部、およびプロセスにおけるそれぞれの役割の概要を示します。&lt;/p&gt;&#10;&lt;h2 id="光学顕微鏡2d"&gt;&#10; 光学顕微鏡（~2D） &#10;&lt;img class="glightbox" src="https://qsysarch.com/images//asic-metrology/optical-microscope.webp#right-h200px" alt="" /&gt;&#10; &lt;a class="heading-link" href="#%e5%85%89%e5%ad%a6%e9%a1%95%e5%be%ae%e9%8f%a12d"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h2&gt;&#10;&lt;p&gt;生物学などで用いられる従来の光学顕微鏡では、位相差を検出するために、光が試料を直接透過する必要があります。しかし、シリコンウェハは完全に不透明で反射率が高いため、光が透過しないため、これらの標準的なシステムは使用できません。&lt;/p&gt;&#10;&lt;p&gt;代わりに、ウェーハ検査では反射光が使用され、明視野、暗視野、DIC（微分干渉コントラスト）などいくつかの種類があります。明視野では、ウェーハに真下から光を照射し、反射光を直接上方に反射させます。一方、暗視野では、ウェーハに急な斜めの角度で光を照射し、粒子汚染、ヘアラインスクラッチ、マイクロ欠陥などの隆起した欠陥を検出できます。&#10;&lt;img class="glightbox" src="https://qsysarch.com/images//asic-metrology/optical-microscopy-reflected.webp" alt="" /&gt;&lt;/p&gt;&#10;&lt;p&gt;ウェハーにとって最も興味深いのは、偏光と特殊なウォラストンプリズムを使用して光を2つの経路に分割し、表面で反射させてから再結合させる微分干渉コントラスト顕微鏡です。ウェハーを3Dのように観察することで、微細な高さの違いや表面の質感を明らかにすることができます。 &#10;&lt;img class="glightbox" src="https://qsysarch.com/images//asic-metrology/optical-microscopy-reflected-light-differential-inference-contrast.webp" alt="" /&gt; (画像出典: &lt;a href="https://www.microscopyu.com/techniques/dic/reflected-light-dic-microscopy" class="external-link" target="_blank" rel="noopener"&gt;Nikon Microscopy&lt;/a&gt;)&lt;/p&gt;&#10;&lt;h2 id="走査型電子顕微鏡-sem"&gt;&#10; 走査型電子顕微鏡 (SEM) &#10;&lt;img class="glightbox" src="https://qsysarch.com/images/asic-metrology/scanning-electron-microscope-internal.webp#right-h300px" alt="" /&gt; &#10;&lt;img class="glightbox" src="https://qsysarch.com/images//asic-metrology/scanning-electron-microscope.webp#right-h200px" alt="" /&gt;&#10; &lt;a class="heading-link" href="#%e8%b5%b0%e6%9f%bb%e5%9e%8b%e9%9b%bb%e5%ad%90%e9%a1%95%e5%be%ae%e9%8f%a1-sem"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h2&gt;&#10;&lt;p&gt;走査型電子顕微鏡（SEM）は、光学顕微鏡よりもはるかに微細な構造を観察できるため（解像度が100倍高い）、半導体製造において最も一般的に使用されている装置の一つです。SEMは光の代わりに集束された電子ビームを用いてウェハ表面を走査し、その形状や組成を高解像度で立体的な画像として得ることができます。&lt;/p&gt;&#10;&lt;p&gt;光学顕微鏡は「一度に画像」を撮影できるのに対し、SEMは非常に細い電子ビームでウェハを点ごとに「走査」し、画像を再構成する必要があります。各ピクセルの明るさは、ウェハ上の対応する位置から検出された電子の数によって決まります。走査には機械部品は使用せず、磁気コイルを用いて磁場を発生させ、電子ビームをわずか数ナノメートル幅のスポットに集束させます（これは、旧式の大型ブラウン管テレビにやや似ています）。&lt;/p&gt;&#10;&lt;h2 id="原子間力顕微鏡-afm"&gt;&#10; 原子間力顕微鏡 (AFM) &#10;&lt;img class="glightbox" src="https://qsysarch.com/images/asic-metrology/atomic-force-microscopy.webp#right-h200px" alt="" /&gt;&#10; &lt;a class="heading-link" href="#%e5%8e%9f%e5%ad%90%e9%96%93%e5%8a%9b%e9%a1%95%e5%be%ae%e9%8f%a1-afm"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h2&gt;&#10;&lt;p&gt;原子間力顕微鏡（AFM）は走査型電子顕微鏡（SEM）とは根本的に異なります。電子を用いるSEMとは異なり、柔軟なカンチレバーに取り付けられた極細の探針を用いて、原子スケールで表面の形状を「感知」し、マッピングします。これは、盲人が点字を読むのとよく似ています。AFMは表面の形状を測定します。&lt;/p&gt;&#10;&lt;p&gt;走査型電子顕微鏡（SEM）と同様に、原子間力顕微鏡（AFM）は表面を点ごとにスキャンします。ただし、放出された電子を記録する代わりに、AFMは探針の高さ、カンチレバーのたわみ、相互作用力など、複数のパラメータを測定することで、真の3D表面マップを作成します。&lt;/p&gt;&#10;&lt;p&gt;カンチレバーは、複数のモードで観測対象と相互作用することができます。接触モードでは、先端はウェーハと常に接触した状態を維持します。タッピングモードでは、カンチレバーは共振周波数付近で振動し、表面との短い接触によって振動振幅が変化します。また、吸引力を測定原理とする非接触モードもありますが、このモードでは信号対雑音比が低くなる傾向があります。&lt;/p&gt;&#10;&lt;h2 id="x線回折xrd"&gt;&#10; X線回折（XRD）&#10;&lt;img class="glightbox" src="https://qsysarch.com/images/asic-metrology/xray-diffractometer.webp#right-500px" alt="" /&gt;&#10; &lt;a class="heading-link" href="#x%e7%b7%9a%e5%9b%9e%e6%8a%98xrd"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h2&gt;&#10;&lt;p&gt;X線回折（XRD）は、主にウェハーの表面を調べる従来の装置とは大きく異なり、材料内部の結晶（または原子）構造をプローブする。&lt;/p&gt;&#10;&lt;p&gt;X線回折（XRD）は、シリコンウェハーの結晶方位、格子間隔、歪み、結晶品質が正しいかどうかを判断するための、最も重要な非破壊測定機器の一つです。表面顕微鏡でウェハーに欠陥がないように見えても、XRDで検出される結晶格子のわずかな変化がトランジスタの性能や製造歩留まりに大きな影響を与える可能性があるため、XRDは不可欠です。&lt;/p&gt;&#10;&lt;div style='clear:both'&gt;&#10;&lt;p&gt;＃＃ まとめ&lt;/p&gt;&#10;&lt;style&gt;&#10;table { width: 100%; }&#10;table, table tr * { border: 1px solid #888;}&#10;table tr td{ padding: 3px; text-align:center;}&#10;&#10;&lt;/style&gt;&#10;&lt;p&gt;| 方法 | # | 解像度 | 速度 | コスト | 一般的な用途 | | &amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash; | &amp;mdash;- | &amp;mdash;&amp;mdash;&amp;mdash;&amp;ndash; | &amp;mdash;&amp;mdash;&amp;mdash; | &amp;mdash;- | &amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;mdash;&amp;ndash; | | 光学 | ~ 2D | ~0.2 µm | 非常に高速 | 低 | 通常のウェーハ検査 | | SEM | ~ 2D | 1–10 nm | 低速 | 高 | 詳細な欠陥分析 | | AFM | 3D | &amp;lt;1 nm (垂直) | 非常に低速 | 高 | 表面粗さ測定 | | X線 | 3D | 変動あり | 中程度 | 高 | 内部構造検査 |&lt;/p&gt;</description></item><item><title>テンソル処理ユニット（TPU）：高レベルシステムアーキテクチャ</title><link>https://qsysarch.com/ja/posts/tpu-architecture/</link><pubDate>Fri, 12 Dec 2025 00:00:00 +0000</pubDate><guid>https://qsysarch.com/ja/posts/tpu-architecture/</guid><description>&lt;img src='https://qsysarch.com/images/tensor-processors/tpu-vs-gpu.webp' style='width:350px;float:right;'&gt;&#10;&lt;p&gt;AIが膨大なエネルギーを消費する世界において、テンソル処理ユニット（TPU）はまさにゲームチェンジャーと言えるでしょう。これは、Googleが機械学習タスク専用に設計したカスタムチップです。&lt;/p&gt;&#10;&lt;p&gt;この簡単なメモは、TPUのアーキテクチャの概要と、2016年の登場以来どのように進化してきたかについて、システムレベルで概説することを目的としています。&lt;/p&gt;&#10;&lt;p&gt;また、この重要な疑問にも答えていきたいと思います。GPUがあるのに、なぜTPUが必要なのでしょうか？GPUにはないどのような利点があるのでしょうか？ニューロモルフィックICと比較するとどうでしょうか？そして、TPUやGPUに代わるアーキテクチャは存在するのでしょうか？&lt;/p&gt;&#10;&lt;p&gt;&#10;&lt;img class="glightbox" src="https://qsysarch.com/images/tensor-processors/tpu-evolution.webp" alt="Tensor Processing Unitの進化の推移" /&gt; (出典: &lt;a href="https://cloud.google.com/transform/ai-specialized-chips-tpu-history-gen-ai" class="external-link" target="_blank" rel="noopener"&gt;Google Cloud&lt;/a&gt;)&lt;/p&gt;&#10;&lt;h1 id="tpuが存在する理由そしてそれが解決する問題とは"&gt;&#10; TPUが存在する理由、そしてそれが解決する問題とは&#10; &lt;a class="heading-link" href="#tpu%e3%81%8c%e5%ad%98%e5%9c%a8%e3%81%99%e3%82%8b%e7%90%86%e7%94%b1%e3%81%9d%e3%81%97%e3%81%a6%e3%81%9d%e3%82%8c%e3%81%8c%e8%a7%a3%e6%b1%ba%e3%81%99%e3%82%8b%e5%95%8f%e9%a1%8c%e3%81%a8%e3%81%af"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h1&gt;&#10;&lt;p&gt;TPUはGPUと同じ目標を共有しています。それは、大規模な並列処理を可能にすることで、ムーアの法則の減速によって生じた制限を克服することです。一般的な計算を処理するために使用できる従来のCPUとは異なり、マルチコアの概念によってある程度の並列処理が可能になっています（&lt;a href="youtube.com/watch?si=C2JVSw49rUYMWXcE&amp;amp;v=7p8ZeSbblec&amp;amp;feature=youtu.be&amp;amp;themeRefresh=1" &gt;デナードのスケーリング法則&lt;/a&gt;のおかげです）。TPUとGPUは、単純で特定のタスクを処理するように設計された専用ハードウェアですが、どのCPUよりもはるかに効率的な方法で処理できます。&lt;/p&gt;&#10;&lt;p&gt;大まかに言えば、汎用CPUやGPUよりもはるかに優れた性能と効率性を実現するには、「汎用性を犠牲にして性能を高める」必要があると言えるでしょう。&#10;&lt;img class="glightbox" src="https://qsysarch.com/images/tensor-processors/systolic-array.webp#right" alt="Google Systolic Array" style="width: 100%; max-width: 480px;"/&gt;&lt;/p&gt;&#10;&lt;p&gt;TPUは、ニューラルネットワークが使用する行列乗算やテンソル演算といった、負荷の高い線形代数処理のために根本的に設計されています。&lt;/p&gt;&#10;&lt;p&gt;TPUの中核を成すのはシストリックアレイと呼ばれるもので、並列計算を実行できる処理要素のマトリックス（通常は_PE_と呼ばれ、右の図では_MAC_と表記されている）である。&lt;/p&gt;&#10;&lt;p&gt;TPUの場合、この処理ユニット（MAC）は、活性化値（埋め込み）とニューラルネットワークの重みを乗算して累積する単純な8ビット乗算器です。この演算を大規模並列処理で実行することによってのみ、TPUはCPUよりもはるかに高いスループットを実現できます。GPUも同様です。しかし、まずはTPUの進化の歴史を見ていきましょう。&lt;/p&gt;&#10;&lt;h1 id="tpuの進化の推移"&gt;&#10; TPUの進化の推移&#10; &lt;a class="heading-link" href="#tpu%e3%81%ae%e9%80%b2%e5%8c%96%e3%81%ae%e6%8e%a8%e7%a7%bb"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h1&gt;&#10;&lt;h2 id="tpuv1-tpuの第一世代"&gt;&#10; TPUv1: TPUの第一世代&#10; &lt;a class="heading-link" href="#tpuv1-tpu%e3%81%ae%e7%ac%ac%e4%b8%80%e4%b8%96%e4%bb%a3"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h2&gt;&#10;&lt;p&gt;TPUv1はわずか15ヶ月で開発され、主な目標はニューラルネットワークの推論性能の向上（学習性能ではなく、推論性能のみ）でした。そのため、Googleは行列乗算器を必要とし、高速化だけでなく消費電力の削減にも制約がありました。消費電力削減の鍵は、メモリ局所性の向上、つまり外部メモリとTPUメモリ間の不要なデータ移動の削減でした。これにより、制御単位あたりの演算強度を高め、TPUがデータを待つアイドル時間を短縮することが可能になります。&lt;/p&gt;&#10;&lt;p&gt;ハードウェアの観点から見ると、TPU v1の設計はシンプルでありながら、洗練された効果を発揮していた。&lt;/p&gt;&#10;&lt;p&gt;標準的なPCIeカードに搭載されたシングルスレッドのコプロセッサ。&lt;/p&gt;&#10;&lt;ul&gt;&#10;&lt;li&gt;&#10;&lt;p&gt;マルチレベルキャッシュ、マルチスレッド、分岐予測は利用できません。&lt;/p&gt;&#10;&lt;/li&gt;&#10;&lt;li&gt;&#10;&lt;p&gt;MXU（行列乗算ユニット）による8ビット整数に対する高速な決定論的演算。&lt;/p&gt;&#10;&lt;/li&gt;&#10;&lt;li&gt;&#10;&lt;p&gt;シストリックアレイは256 * 256 * MXUで構成されます&lt;/p&gt;&#10;&lt;/li&gt;&#10;&lt;/ul&gt;&#10;&lt;p&gt;複雑な処理はソフトウェアスケジューラに移管され、その主な役割は2つある。&lt;/p&gt;&#10;&lt;ul&gt;&#10;&lt;li&gt;MXUがアイドル状態にならないように操作スケジュールを組むことで、パイプを常に稼働状態に保つ。&lt;/li&gt;&#10;&lt;/ul&gt;&#10;&lt;p&gt;メモリアクセスの遅延を隠蔽する手段として、メモリをダブルバッファリングする。&lt;/p&gt;&#10;&lt;p&gt;&#10;&lt;img class="glightbox" src="https://qsysarch.com/images/tensor-processors/tpu-v1-v2-v3.webp" alt="Google Tensor Processing Unit (TPU) の進化、V1 から V3 まで" /&gt;&lt;/p&gt;&#10;&lt;h2 id="tpuv2とv3メモリとインターコネクトの改善"&gt;&#10; TPUv2とv3：メモリとインターコネクトの改善&#10; &lt;a class="heading-link" href="#tpuv2%e3%81%a8v3%e3%83%a1%e3%83%a2%e3%83%aa%e3%81%a8%e3%82%a4%e3%83%b3%e3%82%bf%e3%83%bc%e3%82%b3%e3%83%8d%e3%82%af%e3%83%88%e3%81%ae%e6%94%b9%e5%96%84"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h2&gt;&#10;&lt;p&gt;v2とv3の重要な概念は、バックプロパゲーション、より高い精度、そしてより多くの分散型で相互接続されたTPUを必要とする次世代モデルのトレーニングです。&lt;/p&gt;&#10;&lt;p&gt;ハードウェアコア処理の観点から見ると、彼らは実に多くの優れた概念を導入した。&lt;/p&gt;&#10;&lt;ul&gt;&#10;&lt;li&gt;&#10;&lt;p&gt;デュアルコアチップ、例えば1つの__TPUv2__は2つのTPUで構成されています&lt;/p&gt;&#10;&lt;/li&gt;&#10;&lt;li&gt;&#10;&lt;p&gt;各TPUは、__128*128 MXU__で構成される4倍の規模のシストリックアレイを備えていました。&lt;/p&gt;&#10;&lt;/li&gt;&#10;&lt;li&gt;&#10;&lt;p&gt;標準のIEEE 754 FP16浮動小数点フォーマットの拡張版であるBrain浮動小数点フォーマット（&lt;strong&gt;BF16&lt;/strong&gt;）を使用して、浮動小数点値を処理する機能。&lt;/p&gt;</description></item><item><title>ニューロモルフィックIC：高レベルシステムアーキテクチャ</title><link>https://qsysarch.com/ja/posts/neuromorphic-ics-system-architecture/</link><pubDate>Fri, 28 Nov 2025 00:00:00 +0000</pubDate><guid>https://qsysarch.com/ja/posts/neuromorphic-ics-system-architecture/</guid><description>&lt;p&gt;最近、&lt;a href="https://neuralink.com/" class="external-link" target="_blank" rel="noopener"&gt;Neuralink&lt;/a&gt; について話していたときに、ニューロモルフィック処理ユニット、または NPU について耳にしました。&#10;&lt;img class="glightbox" src="https://qsysarch.com/images/neuromorphic-ics/innatera-pulsar-ic.png#right" alt="Innatera Pulsar IC" style="width: 100%; max-width: 300px;"/&gt; これらの NPU は量子コンピューティングとは何の関係もありませんが、新しい処理アーキテクチャからインスピレーションを得るのに少し時間を費やすのは面白いと思いました。実際、この分野の主要な IC ベンダーの 1 つは、&lt;a href="https://innatera.com/pulsar" class="external-link" target="_blank" rel="noopener"&gt;Innatera&lt;/a&gt; というオランダの会社です。Innatera の最新の IC、&lt;a href="https://innatera.com/pulsar" class="external-link" target="_blank" rel="noopener"&gt;Pulsar&lt;/a&gt; は、低消費電力のスパイクニューラルネットワークに基づいています (右の画像を参照)。&lt;/p&gt;&#10;&lt;p&gt;このメモでは、ニューロモルフィックICのアーキテクチャ、スパイクニューラルネットワークの設計、そしてこれらのデバイスをプログラムするために公開されているソフトウェアスタックについて、可能な限り多くの情報をリバースエンジニアリングして明らかにしようと思います。&lt;/p&gt;&#10;&lt;h1 id="ハードウェアアーキテクチャ"&gt;&#10; ハードウェアアーキテクチャ&#10; &lt;a class="heading-link" href="#%e3%83%8f%e3%83%bc%e3%83%89%e3%82%a6%e3%82%a7%e3%82%a2%e3%82%a2%e3%83%bc%e3%82%ad%e3%83%86%e3%82%af%e3%83%81%e3%83%a3"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h1&gt;&#10;&lt;p&gt;これは、Pulsar IC のアーキテクチャ図を再描画する試みです (元の &lt;a href="https://www.embedded.com/innatera-pulsar-brings-brain-intelligence-to-the-edge/" class="external-link" target="_blank" rel="noopener"&gt;画像&lt;/a&gt;、&lt;a href="https://innatera.com/storage/app/media/Resources/Pulsar.pdf" class="external-link" target="_blank" rel="noopener"&gt;ホワイトペーパー&lt;/a&gt; からの知見を補足しています)。&lt;/p&gt;&#10;&lt;p&gt;&#10;&lt;img class="glightbox" src="https://qsysarch.com/images/neuromorphic-ics/architecture-of-Innatera-Pulsar-neuromorphic-microcontrolle.webp" alt="" /&gt;&lt;/p&gt;&#10;&lt;p&gt;RISC-V CPU を使用するというアイデアは気に入っています。これは、Innatera のチームが初日から正しいアーキテクチャ決定を下している明確な証拠です。Innatera の以前の &lt;a href="https://innatera.com/products/spiking-neural-processor-t1" class="external-link" target="_blank" rel="noopener"&gt;T1&lt;/a&gt; チップの図の 1 つでは、RISC-V CPU に &lt;a href="https://five-embeddev.com/riscv-user-isa-manual/Priv-v1.12/f.html" class="external-link" target="_blank" rel="noopener"&gt;F 拡張機能&lt;/a&gt; (浮動小数点演算サポート) がバンドルされています。&lt;/p&gt;&#10;&lt;p&gt;ICには多くの標準インターフェース（SPI、I2Cなど）と、スリープモードまたは省電力モードに入るときにICの一部をオン/オフする電源管理ユニット（PMU）が統合されています。残念ながら、実際の消費電力に関するデータは、_「1mW未満」_というボールパックの情報以外には見つかりませんでした。1.8Vの電源電圧を想定すると、これは500µA未満になります（&lt;em&gt;I=W/V&lt;/em&gt;）。また、「サイクルあたり」の電力指標が関係するかどうかも疑問です。この場合、100Hzの周波数（シナプス更新周期）を想定すると、平均してシナプス更新あたり5µAになります。&lt;/p&gt;&#10;&lt;p&gt;Pulsarの最新の図には、CNNとFFTという2つのアクセラレータが示されています。これらは、GEMM（汎用行列乗算器、ニューラルネットワーク計算の鍵となるもの）とSFU（特殊機能ユニット、FFT計算を高速化するために使用されるもの）とより広義に表現できると思います。詳細については、GPUアーキテクチャに関する&lt;a href="https://qsysarch.com/posts/cuda-compiler-architecture/" &gt;post&lt;/a&gt;を参照してください。また、RISC-Vのコプロセッサとして開発されたと思われるスパイクエンコーダ/デコーダもありますが、それ以上の詳細は見つかりませんでした。&lt;/p&gt;&#10;&lt;h1 id="スパイクニューラルネットワークアーキテクチャ"&gt;&#10; スパイクニューラルネットワークアーキテクチャ&#10; &lt;a class="heading-link" href="#%e3%82%b9%e3%83%91%e3%82%a4%e3%82%af%e3%83%8b%e3%83%a5%e3%83%bc%e3%83%a9%e3%83%ab%e3%83%8d%e3%83%83%e3%83%88%e3%83%af%e3%83%bc%e3%82%af%e3%82%a2%e3%83%bc%e3%82%ad%e3%83%86%e3%82%af%e3%83%81%e3%83%a3"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h1&gt;&#10;&lt;p&gt;残る疑問は、スパイクニューラルネットワーク、または&lt;a href="https://en.wikipedia.org/wiki/Spiking_neural_network" class="external-link" target="_blank" rel="noopener"&gt;SNN&lt;/a&gt;についてです。これはどのように機能するのでしょうか？&lt;/p&gt;&#10;&lt;h2 id="メタファー"&gt;&#10; メタファー&#10; &lt;a class="heading-link" href="#%e3%83%a1%e3%82%bf%e3%83%95%e3%82%a1%e3%83%bc"&gt;&#10; &lt;i class="fa-solid fa-link" aria-hidden="true" title="見出しへのリンク"&gt;&lt;/i&gt;&#10; &lt;span class="sr-only"&gt;見出しへのリンク&lt;/span&gt;&#10; &lt;/a&gt;&#10;&lt;/h2&gt;&#10;&lt;p&gt;&lt;em&gt;私は&lt;a href="https://gemini.google.com/" class="external-link" target="_blank" rel="noopener"&gt;Gemini&lt;/a&gt;に、スパイクニューラルネットワークについて8歳児にもわかるような比喩表現を考えてもらうよう頼みました。以下が私が得た話です。&lt;/em&gt;&lt;/p&gt;&#10;&lt;p&gt;脳を巨大な郵便局だと想像してみてください。「ニューロン」は、メモを運ぶ小さなメッセンジャーのようなものです。&lt;/p&gt;&#10;&lt;ol&gt;&#10;&lt;li&gt;メッセンジャーとメモ:&lt;/li&gt;&#10;&lt;/ol&gt;&#10;&lt;p&gt;通常のコンピュータプログラムでは、すべてのメッセンジャーが常に数字をやり取りしています。一方、スパイクニューラルネットワークでは、メッセンジャーは非常に静かでエネルギー効率が良く、何か重要なこと（例えば、小さな電気的なスパイク）が発生したときにのみ、短い「やあ！」というメッセージを送信します。&lt;/p&gt;&#10;&lt;ol start="2"&gt;&#10;&lt;li&gt;スパークメーター：&lt;/li&gt;&#10;&lt;/ol&gt;&#10;&lt;p&gt;各メッセンジャーには、他のメッセンジャーから「ヘイ！」という声を聞くと溜まるメーターがあります。メーターが十分に溜まると（閾値に達すると）、そのメッセンジャーも興奮して「ヘイ！」と叫びます。叫んだ直後、メーターはリセットされるため、すぐに再び叫ぶことはできません（不応期）。&lt;/p&gt;&#10;&lt;p&gt;3．タイミングがすべて：&lt;/p&gt;&#10;&lt;p&gt;伝令が立て続けに「ヘイ！」という声を聞いたら、それは非常に重要なメッセージ（例えば「火事だ！」）であることを意味します。もし伝令が他の誰よりも少し早く「ヘイ！」と叫んだら、それは何か特別なことが起こっているという秘密の合図かもしれません（例えば「虎が来るぞ！」）。ですから、伝令は時間感覚を磨く必要があるのです。&lt;/p&gt;&#10;&lt;p&gt;4．学ぶことが鍵となる：&lt;/p&gt;&#10;&lt;p&gt;メッセンジャーはあなたと同じように学習します。例えば、メッセンジャーAが「ヘイ！」と叫んだ直後にメッセンジャーBが「ヘイ！」と叫んだ場合（何かが二人を興奮させたため）、二人の友情はより強固になり、メッセンジャーAのメッセージは次回メッセンジャーBがメーターをより早く満たすのに役立ちます。&lt;/p&gt;</description></item></channel></rss>